FF计算机组成原理实验箱/计算机体系结构开发实验平台 型号:VV511-LH-C12 库号：M79496中西

计算机组成原理实验箱/计算机体系结构开发实验平台  型号:VV511-LH-C12

库号：M79496  

LH-C12 创自设计计算机体系结构开发实验平台 一、实验平台架构与特点1、完全基于FPGA/CPLD的模块架构，结构支持USB的GPIF高速传送，组成如下：1）USB设备开发与接口模块：包含USB核心器件CY7C68013(含8051内核)、串行EEPROM 24LC01B 、SRAM HY62WT081E、EPM3064ATC100、数据总线开关 SN74CB3Q3245、锁存器 74VHC373、方口USB接口。2）平台接口控制用CPLD模块：包含EPM3512AQC208主芯片、备频器DS1080L、JTAG接口等。3）CPU或IP Core用FPGA模块：包含核心器件EP1C12Q240C8、配置芯片EPCS4、JTAG接口等。4）主存模块4MB SRAM，由8片512K SRAM 62V8400A 组成，1MB Flash放BIOS或TOS，由AM29LA800BT组成。5）接口开发用CPLD模块：含EPM1270T144C4和JTAG接口等。6）CPU-BUS扩张模块：含USB双向差分器MAX3346E、SRAM HY62WT081E 7）以太网接口模块：含6PT8515、差分驱动器DS90LV011AH和差分接收器DS90LV012AH。8）串行通信接口：含MAX232电平转换器和RS232-9接口。9）GPIF接口：含SRAM HY62WT081E和IDC-40接口。10）自设计CPU外部接口：含TFT-LCD显示接口、IDE硬盘接口、LAN接口等。2、结构灵活，便于扩充，适宜各种不同结构CPU和目标设计1）完全基于FPGA/CPLD的本身使其结构灵活2）用作CPU/IP Core的FPGA（30万门）和外接口的CPLD使用背板转插，方便更换和维护。3）作CPU的FPGA设计了相当的备份信号并留有较多引脚连接。提供顶层调用目标的详尽描述模板和引脚配置文件。4）接口控制用CPLD（万门）模块逻辑描述开放，增改方便、说明详尽。3、控制简单，操作方便，智能化的控制和检测功能1）带有上位主机的本系统调试debug（WIN2K/XP）软件，对CPU及其组成的实验计算机，具有启、停，程序加载与校验。2）在单步、单指、断点运行时，在CPU的跟踪回收逻辑配合下，debug将自动跟踪回收显示CPU内部寄存器、总线、状态等信息，可及时发现错误。用户可在CPU的跟踪回收逻辑里，自己选择所要看的信息。3）目标CPU可透明使用PC机的各种外部设备，在连续运行时可通过双机（主机与目标CPU）通讯（中断IO方式），输入实验计算机所需要的数据，显示运行数据、结果与状态。 

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